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基于FPGA的DDR3设计#xff08;2#xff09;DDR3各时钟频率及带宽分析 - 知乎 (zhihu.com) DDR3的时钟频率配置要看两个手册#xff1a; 1.DDR3器件的手册。 2.开发板芯片的手册
器件
器件名称#xff1a;MT41J128M16JT-125:K tCK 1.25ns#xff0c;就可以算出…可参考
基于FPGA的DDR3设计2DDR3各时钟频率及带宽分析 - 知乎 (zhihu.com) DDR3的时钟频率配置要看两个手册 1.DDR3器件的手册。 2.开发板芯片的手册
器件
器件名称MT41J128M16JT-125:K tCK 1.25ns就可以算出芯片支持的最大IO时钟频率1/1.25ns 800Mhz;此处的IO时钟频率也就是DDR3的频率。 器件最大支持800MHZ其中核心频率200MHZ工作频率800MHZ。
芯片
K7 A7
