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什么是EDA#xff1f;
EDA是电子设计自动化#xf…EDA工具的使用涵盖了芯片的功能设计、综合、验证、物理设计等环节更是被称作“芯片设计的工作母机”。下面就来为大家具体介绍一下常见的EDA工具。需要EDA虚拟机安装资源文末可领取~
什么是EDA
EDA是电子设计自动化Electronics Design Automation的缩写在半导体行业中属于上游产业块-设计的一个子行业。
EDA技术就是以计算机为工具设计者在EDA软件平台上用硬件描述语言VerilogHDL完成设计文件然后由计算机自动地完成逻辑编译、化简、分割、综合、优化、布局、布线和仿真直至对于特定目标芯片的适配编译、逻辑映射和编程下载等工作。
常见EDA工具有哪些
EDA工具软件可大致可分为芯片设计辅助软件、可编程芯片辅助设计软件、系统设计辅助软件等三类。
目前进入我国并具有广泛影响的EDA软件是系统设计辅助类软件和可编程芯片辅助设计软件Protel、AlTIum Designer、、OrCAD、PCAD、LSIIogic、MicroSim、ISE、modelsim、Matlab等等。
这些工具都有较强的功能一般可用于几个方面例如很多软件都可以进行电路设计与仿真同时还可以进行PCB自动布局布线可输出多种网表文件与第三方软件接口。
需要EDA虚拟机安装资源文末可领取~ IC设计中使用的EDA工具如下
1、架构的设计与验证
按照要求对整体的设计划分模块。
架构模型的仿真可以使用Synopsys公司的CoCentric软件它是基于System C的仿真工具。
2、HDL设计输入
设计输入方法有HDL语言Verilog或VHDL输入、电路图输入、状态转移图输入。
使用的工具有Active-HDL而RTL分析检查工具有Synopsys的LEDA。
3、前仿真工具功能仿真
初步验证设计是否满足规格要求。
使用的工具有Synopsys的VCSSimens EDA的ModelSimCadence的VerilogXLCadence的NC-Verilog。
4、逻辑综合
将HDL语言转换成门级网表Netlist。综合需要设定约束条件就是你希望综合出来的电路在面积时序等目标参数上达到的标准逻辑综合需要指定基于的库使用不同的综合库在时序和面积上会有差异。逻辑综合之前的仿真为前仿真之后的仿真为后仿真。
使用的工具有Synopsys的Design CompilerCadence的 PKSSynplicity的Synplify等。
5、静态时序分析工具STA
在时序上检查电路的建立时间Setuptime和保持时间Hold time是否有违例Violation。
使用的工具有Synopsys的Prime Time。
6、形式验证工具
在功能上对综合后的网表进行验证。常用的就是等价性检查Equivalence Check方法以功能验证后的HDL设计为参考对比综合后的网表功能他们是否在功能上存在等价性。这样做是为了保证在逻辑综合过程中没有改变原先HDL描述的电路功能。
使用的工具有Synopsys的Formality
Cadence概述
作为流行的EDA工具之一Cadence一直以来以其强大的功能受到广大EDA工程师的青睐。Cadence可以完成整个IC设计流程的各个方面如电路图输入(Schematic Input)、电路仿真(Analog Simulation)、版图设计(Layout Design)、版图验证(Layout Verification)、寄生参数提取(Layout Parasitic Extraction)以及后仿真(Post Simulation)。
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